VLSI设计基础(数字集成电路设计基础)(东南大学) 中国大学MOOC作业答案
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【作业】第四章 -时序逻辑电路 第四章时序逻辑作业
1、 问题:根据逻辑f=设计CMOS组合逻辑门电路。如果等效倒相器的NMOS管宽长比为1,PMOS管宽长比为2,(1)试计算组合逻辑门的各MOS管宽长比;(2)如果所设计的组合逻辑门的所有PMOS管宽长比为4,NMOS管宽长比均为2,假设un/up=2,指出哪个是最坏工作情况
评分规则: 【 1)画出电路图,符合逻辑关系共有4种答案,,答出一种即得满分:139/2、74、163/2、86NMOS数字+PMOS数字=39/2+50=139/2;NMOS(数字)+PMOS数字= 24+50=74;NMOS数字+PMOS(数字)= 39/2+62=163/2;NMOS(数字)+PMOS(数字)= 24+62=86
2)上拉网络的最大电阻发生在仅有F、G、D、B导通的情况;串联导致的有效宽长比为4/4=1,因为un/up=2,可以和NMOS管相比拟的总宽长比为1/2.下拉网络的最大电阻在三种情况下发生,AEG,ACD,AEF,有效宽长比均为2/3.这两个情况是最坏工作情况,比值是4/3
】
2、 问题:
评分规则: 【
】
3、 问题:
评分规则: 【 不影响功能,输入端反相器隔离了输入和内部节点,并对触发器提供了一个固定的输入负载。
】
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