某型MIPS指令架构的单周期CPU,其数据通路结构如下图:假设各部件延时(单位:皮秒,即^()秒):存储器读/写ps,ALU/加法器ps,寄存器堆读/写ps,其余部件延时忽略

  尔雅 智慧树 mooc


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